项目10 寄存器和计数器的应用-【职升课堂】电子电器应用与维修1——电子技术基础与技能

2024-03-24
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资源信息

学段 中职
学科 职教专业课
课程 电子技术基础与技能
教材版本 -
年级 -
章节 -
类型 作业-同步练
知识点 寄存器,计数器
使用场景 同步教学-新授课
学年 2024-2025
地区(省份) 全国
地区(市) -
地区(区县) -
文件格式 ZIP
文件大小 1.33 MB
发布时间 2024-03-24
更新时间 2024-03-24
作者 山东强联文化传媒有限公司
品牌系列 -
审核时间 2024-03-24
下载链接 https://m.zxxk.com/soft/44040497.html
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来源 学科网

内容正文:

项目10一寄存器和计数器的应用 10.1寄存器 学习目标 1.了解寄存器的功能、基本构成和常见类型。 2,了解典型集成移位寄存器的引脚功能及应用。 重点:了解寄存器的功能、基本构成和常见类型 难点:寄存器的电路分析,根据输入波形画出输出信号波形。 同步训练 4.时序逻辑电路中一定是含()。 一、单选题 A.触发器 1.具有记忆功能的电路有( B.组合逻辑电路 A.译码器 B.编码器 C.移位寄存器 C.计数器 D.加法器 D.译码器 2.关于时序逻辑电路的特点,下列叙述正确 5.8位移位寄存器,串行输入时经( 的是()。 个脉冲后,8位数码全部移入寄存器中。 A.电路任一时刻的输出只与当时的输入 A.1 B.2 信号有关 C.4 D.8 B.电路任一时刻的输出只与电路原来状 6.下列功能的触发器中,( )不能构成 态有关 移位寄存器。 C.电路任一时刻的输出与该时刻的输入 A.SR触发器 信号和电路原来的状态均有关 B.JK触发器 D.电路任一时刻的输出与该时刻的输入 C.D触发器 信号和电路原来的状态均无关 D.T和T触发器 3.同步时序电路和异步时序电路比较,其差 异在于后者( 7.如图所示电路的功能为( )。 A.没有触发器 D B.没有统一的时钟脉冲控制 C.没有稳定状态 D.输出只与内部状态有关 53 职升课堂·电子电器应用与维修1◆ A.并行寄存器 三、填空题 B.移位寄存器 1.时序逻辑电路是由 和 C.计数器 两部分组成 D.序列信号发生器 2.寄存器是一种用来暂时存放 的逻 8.4位移位寄存器,现态QQQ,Q,为1100 辑部件,具有 和 经左移1位后其次态为( ) 的功能 A.0011或1011 B.1000或1001 3.寄存器中,一个触发器可以存放 位 C.1011或1110 D.0011或1111 二进制代码,要存放n位二进制代码,就 9.现欲将一个数据串延时4个CP的时间,则 要有 个触发器 最简单的办法采用( 4.按逻辑功能的不同,寄存器可分为 A.4位并行寄存器 和 B.4位移位寄存器 5.寄存器具有 功能,可用于暂存 C.4进制计数器 数据。 D.4位加法器 四、电路分析 二、判断题 电路如图所示,设各触发器的初始状态 L,时序逻辑电路在任一时刻的输出只取决 为0。请画出在输入信号作用下,对应的 于电路原来的状态,而与该时刻的输入 输出Q。、Q,的波形,并描述电路实现的 无关。 ( 功能。 2.移位寄存器和数码寄存器没有区别。 ( 3.时序逻辑电路在结构方面的特点是:由具 有控制作用的逻辑门电路和具有记忆作用 的触发器两部分组成。 ( ) C 4.移位寄存器不仅可以寄存代码,而且可以 CP 实现数据的串并行转换和处理。( 5.双向移位寄存器既可以将数码向左移,也 g 可以向右移。 54 第一部分电子技术基础与技能◆◆◆◆◆ 10.2计数器 学习目标 1.了解计数器的应用及计数器的类型。 2.掌握典型的二进制、十进制集成计数器的引脚功能及使用方法。 重难点:掌握典型的二进制、十进制集成计数器的引脚功能及使用方法。 同步训练 B.减法计数器 一、单选题 C.移位寄存器 1.构成计数器的基本单位是( cΠΠΠΠΠΠ A.与门 B.与非门 C.或非门 D.触发器 9 2.在相同的时钟脉冲作用下同步计数器与异 二、判断题 步计数器比较,工作速度()。 1.在异步计数器中,当时钟脉冲到达时,各 A.较快 B.较慢 触发器的翻转是同时发生的。 () C.一样 D.不确定 2.可逆计数器既能作加法计数,又能作减法 3.计数器在电路组成上的特点是( 计数。 ( A.有CP输人端,无数码输入端 3.计数器计数前不需要先清零。() B.有CP输入端,有数码输人端 4.计数器只能用于计数的场合。 ( C,无CP输入端,有数码输入端 5.74LS190只能进行十进制加法计数。 D.无CP输入端,无数码输人端 ( 4.具有记忆功能的电路有( )。 6.构成计数器电路的器件必须具有记忆 A.译码器 B.编码器 功能。 ( C.计数器 D.加法器 三、画图题 5.某时序逻辑电路的波形如图所示,由此判 1.由两个TTL型JK边沿型触发器构成的电路 定该电路是( 如图所示,已知时钟脉冲CP的波形,画 A.加法计数器 55 职升课堂·电子电器应用与维修1◆ 出触发器的输出波形。(设Q和Q,的初始3.试画出如图所示时序电路在一系列CP 状态均为0)》 信号作用下,Q。、Q,、9,的输出电压波 0 cP几几 形。设触发器的初始状态为Q-0 C C<b CA 0 2 K e 2.试分析如图所示时序逻辑电路的逻辑 功能,设各触发器的初始状态Q,Q,Q。 cPΠ几几几几几Π 000,解决下列问题: 0.------------------

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