7.2 组合逻辑电路的分析和设计(课件)-高二《电子技术基础与技能》同步教学(人民邮电版)
2023-07-27
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34页
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普通
资源信息
| 学段 | 中职 |
| 学科 | 职教专业课 |
| 课程 | 电子技术基础与技能 |
| 教材版本 | - |
| 年级 | 高二 |
| 章节 | - |
| 类型 | 课件 |
| 知识点 | 组合逻辑电路 |
| 使用场景 | 同步教学 |
| 学年 | 2023-2024 |
| 地区(省份) | 全国 |
| 地区(市) | - |
| 地区(区县) | - |
| 文件格式 | PPTX |
| 文件大小 | 431 KB |
| 发布时间 | 2023-07-27 |
| 更新时间 | 2023-07-27 |
| 作者 | 匿名 |
| 品牌系列 | - |
| 审核时间 | 2023-07-27 |
| 下载链接 | https://m.zxxk.com/soft/40089970.html |
| 价格 | 0.50储值(1储值=1元) |
| 来源 | 学科网 |
|---|
内容正文:
7.2 组合逻辑电路的分析和设计
7.2.1 组合逻辑电路的分析方法
1. 组合逻辑电路分析的一般步骤
(1) 根据所给定的组合逻辑电路图,写出逻辑函数表达式;
(2) 将表达式化简,以得到最简表达式;
(3) 由表达式列真值表;
(4) 根据真值表来确定电路的逻辑功能,用简练语言说明其功能。
7.2 组合逻辑电路的分析和设计
7.2.1 组合逻辑电路的分析方法
2.组合电路分析举例
【例】已知逻辑电路如图所示,试分析其逻辑功能
7.2 组合逻辑电路的分析和设计
7.2.1 组合逻辑电路的分析方法
7.2.1 组合逻辑电路的设计
组合逻辑电路的设计步骤:
(1) 分析实际问题,根据要求确定输入、输出变量,分析它们之间的关系,将实际问题转化为逻辑问题,确定逻辑变量并赋值。确定什么情况下为1,什么情况下是逻辑0,建立正确的逻辑关系。
(2) 列真值表。根据逻辑功能的描述列真值表。
(3) 由真值表写出逻辑表达式(写出函数最小项之和的标准式)并化简。
(4) 根据最简逻辑表达式,画出相应的逻辑图。
7.2 组合逻辑电路的分析和设计
7.2.1 组合逻辑电路的分析方法
2.组合电路的设计举例
【例】设计一个监视交通信号灯工作状态的逻辑电路。每一组信号灯由红、黄、绿三盏灯组成,如图7.31所示。正常工作情况下,任何时刻必有一盏灯点亮,而且只允许有一盏灯点亮。而当出现其他五种点亮状态时,电路发生故障,这时要求发出故障信号,以提醒维护人员前去修理。
7.3常用组合逻辑电路
7.3.1编码器
1.二进制编码器
将各种有特定意义的输入信息编成二进制代码的电路称为二进制编码器
3位二进制编码器为例,分析编码器的工作原理。
3位二进制编码器示意图
I0、I1…、I7表示8路输入,分别代表十进制数0、1、2…、7八个数字。编码器的输出是3位二进制代码,用Y0、Y1、Y2表示。编码器在任何时刻只能对0、1、2、…、7中的一个输入信号进行编号,不允许同时输入两个1。由此得出编码器的真值表
7.3常用组合逻辑电路
7.3.1编码器
3位二进制编码器真值表
十进制
输入变量
输出
I7 I6 I5 I4 I3 I2 I1 I0
Y2 Y1 Y0
0
00000001
000
1
00000010
001
2
00000100
010
3
00001000
011
4
00010000
100
5
00100000
101
6
01000000
110
7
10000000
111
7.3常用组合逻辑电路
7.3.1编码器
从真值表可以写出逻辑函数表达式
根据逻辑表达式可画出由3个或门组成的3位二进制编码器
3位二进制编码器逻辑图
7.3常用组合逻辑电路
7.3.1编码器
2.二—十进制编码器
将0~9十个十进制数编成二进制代码的电路,叫做二—十进制编码器,也称为10线—4线编码器 I0、I1、I2、…I9表示10路输入, Y0、Y1、Y2、Y3作为4条输出线
3.优先编码器
允许同时输入两个或两个以上输入信号,电路将对优先级别高的输入信号编码,这样的电路称为优先编码器。
7.3常用组合逻辑电路
7.3.1编码器
如图所示,8线-3线74LS148优先编码器的引脚排列图
74LS148优先编码器
7.3常用组合逻辑电路
7.3.1编码器
图中 ~ 为输入端, 的优先权最高,其余输入优先级依次
为。 、 、 输出端,在 电路正常工作状态下,输入低电平0有效,即0表示有信号,1表示无信号,输出均为反码。当 =0时,无论其他输入端有无输入信号(表中以×表示),输出端只对 编码,输出为7的8421BCD码的反码,即 =000。当 =1、 =0时,无论其余输入端有无输入信号,只对 编码,输出为 =001
7.3常用组合逻辑电路
7.3.1编码器
输入
输出
1
0
0
0
0
0
0
0
0
0
× × × × × × × ×
1 1 1 1 1 1 1 1
× × × × × × × ` 0
× × × `× × × ` 0 1
× × × × × 0 1 1
× × × `× 0
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